Intel 64 and IA32 architectures (Registro nro. 899)
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| 000 -Cabecera | |
|---|---|
| fixed length control field | 01202nam a22003377a 4500 |
| 001 - Número de control | |
| control field | NM000899 |
| 003 - Identificador del Número de control | |
| control field | AR-HaUTN |
| 007 - Campo fijo de descripción fija-Información general | |
| fixed length control field | ta |
| 008 - Elementos de longitud fija-Información general | |
| fixed length control field | 48020s2007 ||||||||||||||000 | spa|| |
| 005 - Fecha y hora de la última transacción | |
| control field | 20240930172056.0 |
| 040 ## - Fuente de catalogación | |
| Agencia de catalogación original | AR-HaUTN |
| 245 ## - Mención de título | |
| Título | Intel 64 and IA32 architectures |
| Parte restante del título | optimization reference manual |
| 260 ## - Publicación y distribución | |
| Lugar de edición | Denver |
| Nombre del editor | Intel |
| 300 ## - Descripción física | |
| Extensión | ca. 450 p. |
| Otros detalles físicos | cuadros, gráficos |
| 500 ## - Nota general | |
| Nota general | Indice alfabético, al final del libro |
| 505 ## - Nota de contenido | |
| Título | Intel 64 and IA 32 processor architecture |
| 505 ## - Nota de contenido | |
| Título | General optimization guidelines |
| 505 ## - Nota de contenido | |
| Título | Coding for SIMD architectures |
| 505 ## - Nota de contenido | |
| Título | Optimizing for SIMD integer applications |
| 505 ## - Nota de contenido | |
| Título | Optimizing for SIMD floatingpoint applications |
| 505 ## - Nota de contenido | |
| Título | Optimizing cache usage |
| 505 ## - Nota de contenido | |
| Título | Multicore and Hyperthreading technology |
| 505 ## - Nota de contenido | |
| Título | 64bit mode coding guidelines |
| 505 ## - Nota de contenido | |
| Título | Power optimization for mobile usages |
| 505 ## - Nota de contenido | |
| Título | Application performance tools [ppendix A] |
| 505 ## - Nota de contenido | |
| Título | Using performance monitorin events [Appendix B] |
| 505 ## - Nota de contenido | |
| Título | Instruction latency and throughput [Appendix C] |
| 505 ## - Nota de contenido | |
| Título | Stack alignment [Appendix D] |
| 505 ## - Nota de contenido | |
| Título | Summary of rules and suggestions [Appendix E] |
| 942 ## - Puntos de acceso adicionales KOHA (No-MARC) | |
| Tipo de item KOHA | Libro |
| Withdrawn status | Lost status | Damaged status | Not for loan | Ubicación permanente | Ubicación habitual | Fecha de adquisición | Baja | Signatura topográfica | Código de barras | Último contacto | Precio actual | Tipo de item KOHA |
|---|---|---|---|---|---|---|---|---|---|---|---|---|
| Biblioteca Dr. Jorge S. Muntaner Coll | Biblioteca Dr. Jorge S. Muntaner Coll | 02/06/2013 | 621.38.04 INT = 111 INT | 006863 | 29/05/2018 | 02/06/2013 | Libro |